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Verilog程序的基本设计单元是“模块”( module)。
时间:
2022-03-30 18:14
来源:
未知
作者:
admin
点击:
次
(判断题)20: Verilog程序的基本设计单元是“模块”( module)。 A: 错误 B: 正确
(判断题)20: Verilog程序的基本设计单元是“模块”( module)。
A: 错误
B: 正确
(责任编辑:admin)
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Verilog HDL和 VHDL目前还都不是IEEE标准。
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